FS32K142UAT0VLHT NXP
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FS32K142UAT0VLHT NXP
• Características de funcionamiento – Rango de tensión: 2,7 V a 5,5 V – Rango de temperatura ambiente: -40 °C a 105 °C para el modo HSRUN, de -40 °C a 150 °C para el modo RUN • Núcleo Arm™ Cortex-M4F/M0+, CPU de 32 bits – Admite una frecuencia de hasta 112 MHz (modo HSRUN) con 1,25 Dhrystone MIPS por MHz – Núcleo Arm basado en la arquitectura Armv7 y Thumb-2® ISA – Procesador de señal digital integrado (DSP) – Controlador de interrupción vectorial anidado configurable (NVIC) – Punto flotante de precisión única Unidad (FPU) • Interfaces de reloj: 4 - 40 MHz Oscilador externo rápido (SOSC) con hasta 50 MHz Reloj de entrada cuadrada externa de CC en modo de reloj externo - 48 MHz Oscilador RC interno rápido (FIRC) - 8 MHz Oscilador RC interno lento (SIRC) - 128 kHz Oscilador de baja potencia (LPO) - Hasta 112 MHz (HSRUN) Bucle de bloqueo en fase del sistema (SPLL): hasta 20 MHz TCLK y 25 MHz SWD_CLK - 32 kHz Reloj externo de contador en tiempo real (RTC_CLKIN) • Alimentación gestión – Núcleo Arm Cortex-M4F/M0+ de baja potencia con excelente eficiencia energética – Controlador de gestión de energía (PMC) con múltiples modos de alimentación: HSRUN, RUN, STOP, VLPR y VLPS. Nota: Las escrituras/borrado de CSEc (Seguridad) o EEPROM activarán indicadores de error en el modo HSRUN (112 MHz) porque este caso de uso no puede ejecutarse simultáneamente. El dispositivo deberá cambiar al modo RUN (80 MHz) para ejecutar escrituras/borrados de CSEc (seguridad) o EEPROM. – Activación de reloj y operación de baja potencia compatible con periféricos específicos. • Memoria e interfaces de memoria – Hasta 2 MB de memoria flash de programa con ECC – 64 KB FlexNVM para memoria flash de datos con emulación ECC y EEPROM. Nota: Las escrituras/borrado de CSEc (Seguridad) o EEPROM activarán indicadores de error en el modo HSRUN (112 MHz) porque este caso de uso no puede ejecutarse simultáneamente. El dispositivo deberá cambiar al modo RUN (80 MHz) para ejecutar escrituras/borrados de CSEc (seguridad) o EEPROM. – Hasta 256 KB de SRAM con ECC – Hasta 4 KB de FlexRAM para su uso como emulación SRAM o EEPROM – Hasta 4 KB de caché de código para minimizar el impacto en el rendimiento de las latencias de acceso a la memoria – QuadSPI con soporte HyperBus™ • Analógico de señal mixta: hasta dos convertidores de analógico a digital (ADC) de 12 bits con hasta 32 entradas analógicas de canal por módulo – Un comparador analógico (CMP) con convertidor digital a analógico (DAC) interno de 8 bits • Funcionalidad de depuración: cable serie JTAG Combinaciones de puertos de depuración (SWJ-DP) – Punto de observación y rastreo de depuración (DWT) – Macrocelda de rastreo de instrumentación (ITM) – Unidad de interfaz de puerto de prueba (TPIU) – Unidad de parche y punto de interrupción (FPB) de Flash • Interfaz hombre-máquina (HMI) – Hasta 156 pines GPIO con funcionalidad de interrupción – Interrupción no enmascarable (NM
• Interfaces de comunicaciones – Hasta tres módulos de receptor/transmisor asíncrono universal de baja potencia (LPUART/LIN) con soporte DMA y baja disponibilidad de energía – Hasta tres módulos de interfaz periférica en serie de baja potencia (LPSPI) con soporte DMA y baja disponibilidad de energía – Hasta dos módulos de circuito interintegrado de baja potencia (LPI2C) con soporte DMA y baja disponibilidad de energía – Hasta tres módulos FlexCAN (con soporte CAN-FD opcional) – Módulo FlexIO para emulación de protocolos de comunicación y periféricos (UART, I2C, SPI, I2S, LIN, PWM, etc). – Hasta un Ethernet de 10/100Mbps con soporte IEEE1588 y dos módulos de interfaz de audio síncrona (SAI). • Seguridad y protección: el motor de servicios criptográficos (CSEc) implementa un conjunto completo de funciones criptográficas, tal y como se describe en la especificación funcional SHE (Secure Hardware Extension). Nota: Las escrituras/borrado de CSEc (Seguridad) o EEPROM activarán indicadores de error en el modo HSRUN (112 MHz) porque este caso de uso no puede ejecutarse simultáneamente. El dispositivo deberá cambiar al modo RUN (80 MHz) para ejecutar escrituras/borrados de CSEc (seguridad) o EEPROM. – Número de identificación única (ID) de 128 bits – Código de corrección de errores (ECC) en memorias flash y SRAM – Unidad de protección de memoria del sistema (MPU del sistema) – Módulo de verificación de redundancia cíclica (CRC) – Perro guardián interno (WDOG) – Módulo de monitor de vigilancia externo (EWM) • Temporización y control – Hasta ocho módulos FlexTimers (FTM) independientes de 16 bits, que ofrecen hasta 64 canales estándar (IC/OC/PWM) – Un temporizador de baja potencia (LPTMR) de 16 bits con control de activación flexible – Dos bloques de retardo programables (PDB) con sistema de disparo: un temporizador de interrupción de baja potencia (LPIT) de 32 bits con 4 canales: contador en tiempo real (RTC) de 32 bits • Paquete: QFN de 32 pines, LQFP de 48 pines, LQFP de 64 pines, LQFP de 100 pines, MAPBGA de 100 pines, LQFP de 144 pines, LQFP de 176 pines Opciones de paquete • DMA de 16 canales con hasta 63 fuentes de solicitud mediante DMAMUX
• Características de funcionamiento – Rango de tensión: 2,7 V a 5,5 V – Rango de temperatura ambiente: -40 °C a 105 °C para el modo HSRUN, de -40 °C a 150 °C para el modo RUN • Núcleo Arm™ Cortex-M4F/M0+, CPU de 32 bits – Admite una frecuencia de hasta 112 MHz (modo HSRUN) con 1,25 Dhrystone MIPS por MHz – Núcleo Arm basado en la arquitectura Armv7 y Thumb-2® ISA – Procesador de señal digital integrado (DSP) – Controlador de interrupción vectorial anidado configurable (NVIC) – Punto flotante de precisión única Unidad (FPU) • Interfaces de reloj: 4 - 40 MHz Oscilador externo rápido (SOSC) con hasta 50 MHz Reloj de entrada cuadrada externa de CC en modo de reloj externo - 48 MHz Oscilador RC interno rápido (FIRC) - 8 MHz Oscilador RC interno lento (SIRC) - 128 kHz Oscilador de baja potencia (LPO) - Hasta 112 MHz (HSRUN) Bucle de bloqueo en fase del sistema (SPLL): hasta 20 MHz TCLK y 25 MHz SWD_CLK - 32 kHz Reloj externo de contador en tiempo real (RTC_CLKIN) • Alimentación gestión – Núcleo Arm Cortex-M4F/M0+ de baja potencia con excelente eficiencia energética – Controlador de gestión de energía (PMC) con múltiples modos de alimentación: HSRUN, RUN, STOP, VLPR y VLPS. Nota: Las escrituras/borrado de CSEc (Seguridad) o EEPROM activarán indicadores de error en el modo HSRUN (112 MHz) porque este caso de uso no puede ejecutarse simultáneamente. El dispositivo deberá cambiar al modo RUN (80 MHz) para ejecutar escrituras/borrados de CSEc (seguridad) o EEPROM. – Activación de reloj y operación de baja potencia compatible con periféricos específicos. • Memoria e interfaces de memoria – Hasta 2 MB de memoria flash de programa con ECC – 64 KB FlexNVM para memoria flash de datos con emulación ECC y EEPROM. Nota: Las escrituras/borrado de CSEc (Seguridad) o EEPROM activarán indicadores de error en el modo HSRUN (112 MHz) porque este caso de uso no puede ejecutarse simultáneamente. El dispositivo deberá cambiar al modo RUN (80 MHz) para ejecutar escrituras/borrados de CSEc (seguridad) o EEPROM. – Hasta 256 KB de SRAM con ECC – Hasta 4 KB de FlexRAM para su uso como emulación SRAM o EEPROM – Hasta 4 KB de caché de código para minimizar el impacto en el rendimiento de las latencias de acceso a la memoria – QuadSPI con soporte HyperBus™ • Analógico de señal mixta: hasta dos convertidores de analógico a digital (ADC) de 12 bits con hasta 32 entradas analógicas de canal por módulo – Un comparador analógico (CMP) con convertidor digital a analógico (DAC) interno de 8 bits • Funcionalidad de depuración: cable serie JTAG Combinaciones de puertos de depuración (SWJ-DP) – Punto de observación y rastreo de depuración (DWT) – Macrocelda de rastreo de instrumentación (ITM) – Unidad de interfaz de puerto de prueba (TPIU) – Unidad de parche y punto de interrupción (FPB) de Flash • Interfaz hombre-máquina (HMI) – Hasta 156 pines GPIO con funcionalidad de interrupción – Interrupción no enmascarable (NM
• Interfaces de comunicaciones – Hasta tres módulos de receptor/transmisor asíncrono universal de baja potencia (LPUART/LIN) con soporte DMA y baja disponibilidad de energía – Hasta tres módulos de interfaz periférica en serie de baja potencia (LPSPI) con soporte DMA y baja disponibilidad de energía – Hasta dos módulos de circuito interintegrado de baja potencia (LPI2C) con soporte DMA y baja disponibilidad de energía – Hasta tres módulos FlexCAN (con soporte CAN-FD opcional) – Módulo FlexIO para emulación de protocolos de comunicación y periféricos (UART, I2C, SPI, I2S, LIN, PWM, etc). – Hasta un Ethernet de 10/100Mbps con soporte IEEE1588 y dos módulos de interfaz de audio síncrona (SAI). • Seguridad y protección: el motor de servicios criptográficos (CSEc) implementa un conjunto completo de funciones criptográficas, tal y como se describe en la especificación funcional SHE (Secure Hardware Extension). Nota: Las escrituras/borrado de CSEc (Seguridad) o EEPROM activarán indicadores de error en el modo HSRUN (112 MHz) porque este caso de uso no puede ejecutarse simultáneamente. El dispositivo deberá cambiar al modo RUN (80 MHz) para ejecutar escrituras/borrados de CSEc (seguridad) o EEPROM. – Número de identificación única (ID) de 128 bits – Código de corrección de errores (ECC) en memorias flash y SRAM – Unidad de protección de memoria del sistema (MPU del sistema) – Módulo de verificación de redundancia cíclica (CRC) – Perro guardián interno (WDOG) – Módulo de monitor de vigilancia externo (EWM) • Temporización y control – Hasta ocho módulos FlexTimers (FTM) independientes de 16 bits, que ofrecen hasta 64 canales estándar (IC/OC/PWM) – Un temporizador de baja potencia (LPTMR) de 16 bits con control de activación flexible – Dos bloques de retardo programables (PDB) con sistema de disparo: un temporizador de interrupción de baja potencia (LPIT) de 32 bits con 4 canales: contador en tiempo real (RTC) de 32 bits • Paquete: QFN de 32 pines, LQFP de 48 pines, LQFP de 64 pines, LQFP de 100 pines, MAPBGA de 100 pines, LQFP de 144 pines, LQFP de 176 pines Opciones de paquete • DMA de 16 canales con hasta 63 fuentes de solicitud mediante DMAMUX
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